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Lundi 10 Septembre se déroulait la conférence de presse au sujet du nouveau processeur d'AMD, l'Opteron 23xx et 83xx, basé sur l'architecture Barcelona. Nous vous proposons donc un rapport-synthèse de cette conférence.

Le nouveau Opteron, de 3e génération, sur plateforme seconde génération, nous a tous de suite été introduit comme un processeur à haute efficacité énergétique, consommant autant que son homologue de 2e génération, mais avec 2 coeurs de plus. Sur les 3 segments, seuls 2 seront disponibles dès le lancement: le segment standard, proposant des processeurs allant jusqu'à 2.0 GHz, le segment "SE" proposant des processeurs EE (Energy Efficient) allant jusqu'à 1.9 Ghz. Les Barcelona à 2.5 Ghz sont prévus pour le Q4 de cette année.

Le Barcelona est fabriqué massivement à Fab 36, avec une technologie SOI de 65 nm, qui diffère de chez Intel, et AMD semble mettre en avant une meilleure efficacité énergétique avec cette technologie. Au niveau du processeur lui même, on assiste à des changements, et à des non-changements... D'un côté, toute la partie cache a été entièrement remaniée, proposant à la fois un cache L1 de 64 Kb par core (pas de changements), couplé à un cache L2 de 512 Ko par core, épaulé par 2 Mo de L3 partagé. Les informations du cache L1 ne sont présentes que dans le L1, contrairement à chez Intel où le cache L1 est aussi présent sur le L2. Ce procédé de "victim cache" permet de libérer du cache. AMD annonce son cache L2 et L3 comme "intelligent", le cache L2 peut déterminer si l'information qu'il contient est destiné à un seul core, dans ce cas elle reste en L2, ou si elle a besoin d'être partagée, donc passe en L3.

Le fait d'avoir un cache L2 par core, permeterait à AMD d'optimiser les latences. Il n'y aura pas d'amélioration du bus Hypertransport sur le Barcelona (contrairement au Phenom et au Budapest), cependant il y a une grosse optimisation du prefetch DDR2, ce qui permetera aussi de ne pas utiliser de la FBDIMM (Encore là aussi, un gain d'énergie), le controlleur mémoire (ECC, donc 2x72 bits) supportera de la DDR2-667, même si AMD indique la possibilité de mettre de la DDR2-800. (La DDR3 ne sera introduite qu'avec la 4Gen).

Une des grandes amélioration du controleur mémoire réside dans son domaine d'alimentation séparé, ce qui permet au Crossbar Switch de voir sa fréquence augmenter d'environ 200 MHz par rapport à un cas où les Voltages seraient liés. Cela permet aussi au processeur de continuer à répondre à l'Hypertransport, même en cas de travail du controlleur mémoire. AMD introduit aussi le Power Now (Cool Core) sur les desktop, avec la possibilité de moduler la fréquence de chaque coeur indépendament (controlé par le driver ou l'OS), ainsi que le controleur mémoire et les caches.

Le Barcelona comporte 463 millions de transistor pour la partie core, et environ 140 millions pour la partie cache mémoire, soit au total environ 600 millions, et il possède 12 niveaux de pipelines, contre 16 pour Intel et son Conroe.

A TDP presque égal (2350 contre 5345) AMD serait beaucoup plus efficace énergiquement que Intel, malgré le fait que le Xeon soit cadencé à 2.66 Ghz, contre 2.0 Ghz seulement pour l'Opteron. Les performances en virtualisation semble aussi nettement améliorée.

D'ici la fin de l'année apparaitra pour les stations de travail mono processeur, le Budapest, Opteron 1000, ainsi que pour le Desktop, le Phenom qui sera disponible pour sa part en Décembre sur Socket AM2, compatible visiblement avec les chipset R6XX d'AMD. De nouveaux chipset R7XX devraient voir le jour pour permetre de nouvelles montées en fréquences. Enfin, actuellement AMD travail d'arrache pied sur le 45 nm, maintenant que le Barcelona est en phase de production massive. D'ici 2009, la 4e Génération d'Opteron devrait faire son apparition, en 45nm et octal-core, sur les plateformes 3 Génération.

Il n'y a malheureusement eut que peu de questions. Elles ont essentiellement porté sur le controlleur mémoire, nous avons pu apprendre que deux VRM distincts controleraient le Core et le controlleur mémoire, même si provenant du rail 12V1 de l'alimentation uniquement, puisque le CPU contrôle le voltage du controlleur mémoire.

Voici la présentation accompagnant la conférence de presse:

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